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电力 制造 汽车 医疗 嵌入式系统 通信 应用开发 国防 政府 地理空间 航空 航天 学习与真实世界零距离的可视化建模 完全支持行业标准的建模工具 模型驱动的开发 UML建模, 系统工程, 嵌入工程, 软件架构, 调试, 数据库工程, 业务分析, 用户界面设计, 测试, 仿真, 企业架构, 等等。 UML, SysML, DDS, BPMN, BPEL, TOGAF, C++, .NET, Java, ASP, PHP, Delphi, SoaML, ArcGIS, SOMF, XML, XSD, XMI, WSDL, 以及更多 了解学术版的详细信息，请查看: www.sparxsystems.cn 获取 学术版 适应各行各业的应用学习 我们世界各地的35万注册用户，几乎涵盖所有领域 - Enterprise Architect 向你的学生提供他们需要的教育基础。 学术版许可 帮助学生获得模型驱动开发的技能 欢迎您咨询和申请我们的学术版许 可。 • 轻松纳入教学课程 • 支持UML2.4和相关的开放标准 • 促进协作和团队工作 • 制作令未来雇主印象深刻的学术作品 • 向你的课程注入新的生命 • 被福布斯排名百强中的75%的企业所采用 • 生成RTF，HTML和PDF格式的报告

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电力制造

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学习与真实世界零距离的可视化建模

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分析和设计采用全球标准的可视化建模根据最新的标准建立教学课程• UML®, SysML, BPMN™, BPEL, SoaML®, SOMF, WSDL™, XSD, DDS™, & ArchiMate® • 支持全部14种UML 2.4.1 图 • 对需求建模，分析，直至设计，部署和维护

可扩展性 研究和定义新的建模标准使用了： • Profile, 图形脚本, 元模型等等

模型仿真 使用仿真对设计进行评估：• 仿真状态机, 活动图, 交互顺序图和BPMN图 • 采用用户界面图执行交互仿真 • 使用触发器，效应作用和信号控制设置流程 • 运行多线程模拟 • 使用JavaScript 和VBscript控制仿真过程

模型驱动开发 软件开发关注模型和代码之间的连接 - 培养学生:• 使用MDA转换，将平台独立模型（PIM）转换成平 台相关模型（PSM）• 定义MDA转换模板 • 从状态图，活动图，交互图和BPMN/ BPEL图生成 行为代码 • 源代码的正向和反向工程 (C++, C, Java, VB.NET, C#, PHP, Delphi, Visual Basic, Action Script, Python 等等) • 定制代码生成

集成开发，可视化设计和调试过程调动学生去构造，调试和改进代码• 在语法高亮和智能感知帮助下编写模型代码• 构建，调试和测试模型的软件系统 • 可视化执行分析器帮助你了解和改进软件• 与Visual Studio 或Eclipse集成使用• 无需重新编译或修改代码的替换测试

数据库建模和工程 掌握从概念到实体的数据建模：• 从（平台无关的）逻辑到实体数据库架构的MDA转换 • 对数据库的正向和反向工程，包括：SQL Server, Oracle, MySQL, DB2, Sybase PostgreSQL, Firebird/InterBase, Informix, Ingres 等等 • 支持标注: DDL, ERD, IDEF1X 与信息工程符号

系统工程-嵌入式系统 使用代码生成，学习对嵌入式系统的建模• 包括SysML的仿真和参数的SysML1.3模型 • 生成从行为模型到C, C++, C#, Java, VB.Net 和SystemC的可执行代码 • 生成硬件定义语言代码（ADA，VHDL和Verilog）

项目和团队 协作 建立学生团队的协作：• 通过甘特图，交流论坛和基于模型内邮件进行项目管理• 使用版本控制，审计报告，基线差异比较和图的可视化比 较

生成报告 达成对任务进行出色的表达 • 详尽的报告功能 • 自定制RTF, PDF 和HTML格式的报告


Accelerating Mixed-Signal Design - MathWorks€¦ · SYSTEM-DESIGN Analog SPICE Digital VHDL, Verilog System Simulink PROTOTYPE TAPEOUT FOUNDRY Test equipment SPECIFICATION TION.

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Sistemas Digitais - cin.ufpe.brvoo/sd/Aula6.Verilog.pdf · Introdução •Verilog é uma linguagem, como VHDL, largamente usada para descrever sistemas digitais e utilizada universalmente;

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1) Einf¨uhrung in die formale Verifikation · • Hardware-Beschreibungssprachen (Verilog, VHDL, ... Modell wird als mathematische Struktur A model angesehen Korrektheitseigenschaft

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Verilog HDL’e Giriş - fpga.gen.tr · VHDL, 1987, Amerika Birleşik Devletleri Savunma Bakanlığı Sponsorluğunda.

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Customer Highlight - Synopsys...VHDL / Verilog VCS Design Compiler ASIC ... カスタム・プロセッサ / プログラマブル・ハードウェア・アクセラレータ 開発の「シフトレフト」を実現するASIP

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VHDL vs. Verilog - · PDF fileEinleitung Grundlagen Programbeispiele azitF VHDL vs. Verilog Anke Kamp Frank Schmidt Florian Thiem Fachbereich Elektrotechnik und Informatik Hochschule

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Presentacion: Usando Archimate

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