第三节 存储器容量的扩展及应用
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1 第第第 第第第第第第第第第第第 第第第 第第第第第第第第第第第 第第第 第第第第第第第第第第第 第第第第第 第第第第第 第第第第第 第第第第第 第第第第第第第第第第第第 第第第第第第第第第第第第 下下 下下 下下下 下下下 下下 下下
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第三节 存储器容量的扩展及应用. 位扩展方式. 字扩展方式. 用存储器实现组合逻辑函数. 总目录. 推出. 下页. 一、位扩展方式. 如果每一片 ROM 或 RAM 中的字数已够用， 而每个字的位数不够用时，应采用位扩展的连接方式。. RAM 的位扩展接法. 上页. 下页. 返回. 2 线 —4 线译码器. 二、字扩展方式. 如果每一片 ROM 或 RAM 中的位数够用， 而字数不够用时，应采用字扩展的连接方式。. 上页. 下页. 返回. 字扩展中各片 RAM 电路的地址分配. 上页. 下页. 返回. 三、用存储器实现组合逻辑函数. - PowerPoint PPT Presentation
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第三节 存储器容量的扩展及应用
第三节 存储器容量的扩展及应用第三节 存储器容量的扩展及应用
位扩展方式位扩展方式
字扩展方式字扩展方式
用存储器实现组合逻辑函数用存储器实现组合逻辑函数
下页下页 总目录总目录推出推出
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一、位扩展方式
I / O
0A 1A 9A R/WCS
11024RAM
0/OI
I / O
0A 1A 9A R/WCS
11024RAM
1/OI
I / O
0A 1A 9A R/WCS
11024RAM
7/OI
CS /R W
0A1A
9A
RAM 的位扩展接法
如果每一片 ROM 或 RAM 中的字数已够用，
而每个字的位数不够用时，应采用位扩展的连接方式。
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8A
9A
0Y1Y2Y3Y
2 线— 4 线译码器
二、字扩展方式如果每一片 ROM 或 RAM 中的位数够用，
而字数不够用时，应采用字扩展的连接方式。
0A1A
7A
/R W
7I/O
0A 1A 7A R/WCS
8256RAM
0I/O
)1(
7I/O
0A 1A 7A R/WCS
8256RAM
0I/O
(2)
7I/O
0A 1A 7A R/WCS
8256RAM
0I/O
(3)
7I/O
0A 1A 7A R/WCS
8256RAM
0I/O
(4)
0/OI
7/OI
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字扩展中各片 RAM 电路的地址分配
器件编号
地址范围 （等效十进制数）
RAM
(1) 0 0 0 1 1 100 00000000 ~ 00 11111111
(0) (255)RAM
(2) 0 1 1 0 1 100 00000000 ~ 00 11111111
(256) (511)RAM
(3) 1 0 1 1 0 100 00000000 ~ 00 11111111
(512) (767)RAM
(4) 1 1 1 1 1 000 00000000 ~ 00 11111111
(768) (1023)
8A9A8A9A 6A7A 4A5A
1Y0Y 3Y2Y2A3A 0A1A
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三、用存储器实现组合逻辑函数
0 0
0 1
0 1 0 1
1 0 1 1
1 0
1 1
0 1 1 0
1 1 0 0
1D0D 3D2D0A1A 1D0D 3D2D0A1A一个 ROM 的数据表
如果将输入地址 A1 和 A0 视为两个输入逻辑变量，同时将输出数据 D0 、 D1 、 D2 和 D3 视为一组输出逻辑变量，
则 D0 、 D1 、 D2 和 D3 就是一组 A1 、 A0 的组合逻辑函数，上表也就是这一组多输出组合逻辑函数的真值表。
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0 0
0 1
0 1 0 1
1 0 1 1
1 0
1 1
0 1 1 0
1 1 0 0
1D0D 3D2D0A1A 1D0D 3D2D0A1A一个 ROM 的数据表
任何形式的组合逻辑函数均能通过向 ROM 中写入相应的数据来实现。
用具有 n位输入地址、 m位数据输出的 ROM 可以获得一组（最多为 m个）任何形式的 n变量组合逻辑函数，只要根据函数的形式向 ROM 中写入相应的数据即可。
这个原理也适用于 RAM 。
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[ 例 7.5.1] 试用 ROM 产生如下的一组多输出逻辑函数。1
2
3
4
Y A BC A B C
Y AB CD BCD A BCD
Y ABCD A BC D
Y A B CD ABCD
1
2
3
4
Y A BCD A BCD A B CD A B CD
Y AB CD A BCD ABCD A BCD
Y ABCD A BC D
Y A B CD ABCD
1524
1443
1410762
76321
mmY
mmY
mmmmY
mmmmY
解：将输出函数展开成标准与 - 或表达式：
三、用存储器实现组合逻辑函数
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（ ）
1
1
1
1A
B
C
D
)( 3A
)( 2A
)( 1A
)( 0A
0W 2W3W
4W5W
6W7W
8W9W
10W11W
12W13W
14W15W1W
1Y
2Y
3Y
4Y
地址译码器
与逻辑阵列
（ ）
存储矩阵
或逻辑阵列
例 7.5.1 的 ROM 点阵图
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